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嵌入式硬件工程師（FPGA方向） 崗位要求

1. 核心技能要求
- 精通Verilog/VHDL硬件描述語言，具備MIPI CSI/DSI協(xié)議FPGA驅(qū)動開發(fā)經(jīng)驗，能獨立完成多路攝像頭、LCOS屏的MIPI接口邏輯設計與調(diào)試。
- 熟悉FPGA內(nèi)部資源（時鐘管理、FIFO、DMA、GPIO）的配置與優(yōu)化，掌握視頻圖像處理相關邏輯設計（如幀同步、視頻合成、分屏顯示）。
- 具備FPGA與ARM異構(gòu)系統(tǒng)開發(fā)經(jīng)驗，能實現(xiàn)兩者間的數(shù)據(jù)交互（如通過AXI總線、SPI/I2C），支撐雙屏驅(qū)動與視頻流傳輸方案落地。
- 熟練使用主流FPGA開發(fā)工具（如Vivado、Quartus），掌握邏輯仿真（ModelSim）、時序分析與約束編寫，能定位并解決時序違例、信號完整性等問題。
2. 硬件能力要求
- 能配合完成FPGA核心板硬件電路設計，熟悉高速信號（MIPI、LVDS）布線規(guī)則，具備硬件調(diào)試能力，可使用示波器、邏輯分析儀排查接口通信故障。
- 了解攝像頭、LCOS屏的硬件特性與寄存器配置，能根據(jù)器件規(guī)格書完成FPGA驅(qū)動的寄存器初始化序列編寫。
3. 項目經(jīng)驗要求
- 有多路視頻輸入輸出FPGA項目經(jīng)驗優(yōu)先，例如雙攝像頭數(shù)據(jù)采集、雙屏同步顯示相關開發(fā)經(jīng)歷。
- 具備嵌入式視覺類項目（如機器視覺、便攜顯示設備）開發(fā)經(jīng)驗者優(yōu)先。
4. 綜合素質(zhì)要求
- 具備良好的問題分析與解決能力，能在無完整源碼的情況下，通過器件規(guī)格書與時序波形完成驅(qū)動調(diào)試。
- 具備團隊協(xié)作意識，能與ARM軟件、結(jié)構(gòu)工程師協(xié)同推進項目，輸出清晰的技術文檔。