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崗位職責：
1. 架構與設計： 參與系統(tǒng)方案討論，負責FPGA子系統(tǒng)的架構設計、模塊劃分和關鍵技術指標的實現(xiàn)。
2. 代碼實現(xiàn)： 使用Verilog HDL/SystemVerilog/VHDL進行高質量的RTL代碼設計、仿真和邏輯綜合。
3. 仿真驗證： 搭建和維護模塊級、系統(tǒng)級仿真測試平臺（UVM/類似方法學），進行充分的仿真驗證，確保設計功能正確。
4. 調試與測試： 主導FPGA的板級調試，利用邏輯分析儀等工具進行時序分析、性能測試和故障定位。
5. 時序與約束： 進行時序分析，編寫時序約束（SDC），優(yōu)化設計以達到時序收斂和性能目標。
6. 協(xié)同工作： 與硬件工程師協(xié)作完成PCB設計；與軟件工程師協(xié)作進行驅動開發(fā)和軟硬件聯(lián)調；配合總體開展系統(tǒng)級匹配驗證。
7. 文檔編寫： 撰寫詳細的設計文檔、測試報告和使用手冊。
任職要求：
1. 學歷與專業(yè)： 電子工程、微電子、通信、計算機等相關專業(yè)，本科及以上學歷。
2. 工作經驗：
· 高級FPGA工程師： 5年以上經驗，有獨立負責復雜FPGA項目或子系統(tǒng)全程開發(fā)的經驗。
3. 核心技能：
· 精通硬件描述語言： 熟練掌握Verilog或VHDL進行RTL設計，有良好的代碼風格。
· 熟悉開發(fā)流程與工具： 精通FPGA開發(fā)工具鏈（Vivado/Quartus）。
· 深入理解數(shù)字電路： 深刻理解數(shù)字邏輯、時序分析、同步/異步設計、時鐘域交叉（CDC）等關鍵概念。
· 仿真與調試能力： 具備豐富的功能仿真和板級調試經驗，能快速定位并解決問題。
· 腳本能力： 熟悉Tcl、Python或Shell等腳本語言，用于自動化流程。
優(yōu)先考慮條件：
1.嵌入式系統(tǒng)開發(fā)經驗，熟悉基于FPGA的軟核（如MicroBlaze, Nios II）或硬核（如Zynq, Agilex）嵌入式系統(tǒng)開發(fā)，具有ZYNQ平臺開發(fā)經驗者優(yōu)先；
2.具有常見密碼算法IP核開發(fā)經驗者優(yōu)先；
3.熟悉以太網(wǎng)、DDR/DDR2、PCI/PCIE等接口協(xié)議。