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更新于 9月30日

邏輯fpga工程師

1.4-2萬(wàn)
  • 成都金牛區(qū)
  • 3-5年
  • 本科
  • 全職
  • 招1人

職位描述

Verilog HDL計(jì)算機(jī)硬件電子/半導(dǎo)體/集成電路
崗位職責(zé):
1、負(fù)責(zé)產(chǎn)品需求分析及方案(邏輯)的設(shè)計(jì)評(píng)估;
2、負(fù)責(zé)邏輯代碼的設(shè)計(jì)、仿真、綜合實(shí)現(xiàn)及聯(lián)調(diào);
3、對(duì)所負(fù)責(zé)的產(chǎn)品邏輯進(jìn)行代碼優(yōu)化、維護(hù)及新技術(shù)的實(shí)現(xiàn);
4、負(fù)責(zé)開發(fā)過程中相關(guān)技術(shù)文檔的撰寫和整理;
5、符合GBJ三庫(kù)管理要求。
其他要求:
1、本科及以上學(xué)歷,計(jì)算機(jī)、電子、通信等相關(guān)專業(yè);

2、3-5年FPGA開發(fā)經(jīng)驗(yàn),且具有JG領(lǐng)域邏輯開發(fā)經(jīng)驗(yàn);

3、熟悉xilinx的FPGA開發(fā)流程等;

4、熟練掌握高速接口,總線協(xié)議,網(wǎng)絡(luò)協(xié)議等;

5、具有豐富的國(guó)產(chǎn)FPGA使用經(jīng)驗(yàn);

6、具有豐富的項(xiàng)目經(jīng)驗(yàn),掌握本行業(yè)及相關(guān)行業(yè)的發(fā)展動(dòng)態(tài);

7、985/211院校碩士研究生可放低工作年限/經(jīng)驗(yàn)。

工作地點(diǎn)

四川省成都市金牛區(qū)興科中路3號(hào)

職位發(fā)布者

曾女士/HR

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公司Logo成都凌亞科技有限公司
成都凌亞科技有限公司成立于2002年,注冊(cè)地位于成都金牛高新技術(shù)產(chǎn)業(yè)園區(qū),注冊(cè)資本3100萬(wàn)元,是一家專業(yè)從事軍事電子信息裝備研發(fā)、生產(chǎn)與銷售的民營(yíng)高新技術(shù)企業(yè)。公司目前可提供基于國(guó)內(nèi)外各種處理器的嵌入式計(jì)算機(jī)模塊的系列開發(fā),產(chǎn)品覆蓋數(shù)據(jù)采集、信號(hào)處理、數(shù)據(jù)處理、通信交換、接口控制、高可靠性電源、大容量存儲(chǔ)與圖形圖像處理、人工智能等多個(gè)產(chǎn)品應(yīng)用于機(jī)載、彈載、艦載、車載等多個(gè)領(lǐng)域的武器裝備之中。經(jīng)過近20年的技術(shù)積累,公司在嵌入式計(jì)算機(jī)模塊的國(guó)產(chǎn)化、寬溫工作、耐振動(dòng)、低功耗、小型化等方面有豐富的技術(shù)儲(chǔ)備和研究設(shè)計(jì)、實(shí)施經(jīng)驗(yàn)。
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