職位描述
FPGAVHDLVivadoModelsim時序約束AuroraMATLAB計算機軟件計算機硬件通信/網(wǎng)絡設備
崗位職責：
1. 參與項目需求分析與論證，支撐項目爭取和方案設計的技術細節(jié)；
2. 研究項目技術細節(jié)，進行核心模塊的詳細設計；
3. 負責FPGA單元架構(gòu)設計，完成FPGA系統(tǒng)仿真，制定FPGA單元結(jié)構(gòu)設計文檔；
4. 分析并解決開發(fā)過程中的重點、難點問題，完成FPGA資源及時序優(yōu)化；
5. 配合軟、硬件工程師、系統(tǒng)測試工程師完成產(chǎn)品測試，以滿足任務目標；
6. 負責硬件架構(gòu)設計，根據(jù)項目需求提出合理的平臺解決方案；
7. 負責采集處理板卡相關的技術約束，提出外協(xié)技術協(xié)議，把控外協(xié)成本、進度、質(zhì)量和相應的共性能要求；
8. 指導測試人員完成數(shù)字基帶相關外協(xié)件的測試驗收；1. 參與項目需求分析與論證，支撐項目爭取和方案設計的技術細節(jié)；
2. 研究項目技術細節(jié)，進行核心模塊的詳細設計；
3. 負責FPGA單元架構(gòu)設計，完成FPGA系統(tǒng)仿真，制定FPGA單元結(jié)構(gòu)設計文檔；
4. 分析并解決開發(fā)過程中的重點、難點問題，完成FPGA資源及時序優(yōu)化；
5. 配合軟、硬件工程師、系統(tǒng)測試工程師完成產(chǎn)品測試，以滿足任務目標；
6. 負責硬件架構(gòu)設計，根據(jù)項目需求提出合理的平臺解決方案；
7. 負責采集處理板卡相關的技術約束，提出外協(xié)技術協(xié)議，把控外協(xié)成本、進度、質(zhì)量和相應的共性能要求；
任職要求：
1.本科及以上學歷，電子通信等相關專業(yè)畢業(yè)；
2.熟練掌握Verilog或VHDL硬件描述語言，具有獨立的FPGA開發(fā)、仿真與調(diào)試能力；
3.熟悉高速信號處理方法，包括DDC、DUC、信號調(diào)制或解調(diào)處理等；
4.熟悉PCIE、JESD204B、Aurora或SRIO等高速接口調(diào)試；
5 熟悉高速AD/DA的基本調(diào)試與應用；
6.熟悉常規(guī)通信接口SPI、UART、SPI或I2C等；
7.熟練掌握Xilinx芯片開發(fā)環(huán)境及仿真調(diào)試工具；
8.具有信號監(jiān)測相關領域工作經(jīng)驗者優(yōu)先。2.熟練掌握Verilog或VHDL硬件描述語言，具有獨立的FPGA開發(fā)、仿真與調(diào)試能力；
3.熟悉高速信號處理方法，包括DDC、DUC、信號調(diào)制或解調(diào)處理等；
4.熟悉PCIE、JESD204B、Aurora或SRIO等高速接口調(diào)試；
5 熟悉高速AD/DA的基本調(diào)試與應用；
6.熟悉常規(guī)通信接口SPI、UART、SPI或I2C等；
7.熟練掌握Xilinx芯片開發(fā)環(huán)境及仿真調(diào)試工具；
職位福利：五險一金、年底雙薪、績效獎金、餐補、彈性工作、節(jié)日福利、周末雙休、股票期權(quán)
工作地點
成都科園二路10號航利中心3棟1單元17樓
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職位發(fā)布者
張女士/HR
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成都藍色起源科技有限公司藍色起源是國內(nèi)領先的無線通信信號處理高科技企業(yè)，近年業(yè)務高速發(fā)展，未來市場前景廣闊。公司提供具備行業(yè)競爭力的薪酬、福利體系，多通道職業(yè)發(fā)展晉升體系，行業(yè)精英、大牛帶隊的人才培養(yǎng)體系，優(yōu)越的辦公環(huán)境，便利的交通條件，寬松快樂的工作氛圍。誠邀行業(yè)優(yōu)秀人才加入團隊。福利待遇： 1、薪資收入：富有行業(yè)競爭力的薪酬體系，每年2次普調(diào)；含固定月薪、年終獎、項目獎金及合伙持股激勵； 2、工作時間：周一至周五9:00-18:00，周末雙休，法定節(jié)假日按規(guī)定休息； 3、晉升通道：雙通道職業(yè)晉升保障，各類人才具有專業(yè)序列逐級晉升及管理崗位晉升通道； 4、福利補貼：五險一金：按標準繳納，其中公積金單向繳費比例為6%；5、節(jié)日補貼：結(jié)婚、生子 1000元/人，元旦、端午、中秋 500元/人，員工生日賀金、賀禮；午餐補貼、加班晚餐補貼；健康檢查：每年定期組織一次員工體檢；6、其他：豐富的團隊建設活動
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