職位描述
VerilogVerilog HDLFPGA計(jì)算機(jī)硬件電子/半導(dǎo)體/集成電路計(jì)算機(jī)軟件
崗位職責(zé)：
(1)產(chǎn)品FPGA系統(tǒng)的需求分析，設(shè)計(jì)實(shí)現(xiàn)，功能驗(yàn)證，維護(hù)；
(2)完成產(chǎn)品中FPGA部分的邏輯接口設(shè)計(jì)開發(fā)；(3)完成產(chǎn)品中FPGA部分的算法設(shè)計(jì)開發(fā)；
(4)協(xié)助電子工程師完成相關(guān)硬件接口的功能測(cè)試驗(yàn)證，解決硬件問題；
(5)與軟件工程師一起完成相關(guān)驅(qū)動(dòng)接口功能性能的調(diào)試；
(6)高速信號(hào)的采集和調(diào)試；
(7)圖像算法類硬件加速的仿真和實(shí)現(xiàn)；(8)FPGA相關(guān)接口文檔協(xié)議的編寫。
任職要求：
1，本科或以上學(xué)歷，電子，計(jì)算機(jī)，自動(dòng)化，物聯(lián)網(wǎng)等相關(guān)專業(yè)；
2，精通/熟悉Xilinx或Altera FPGA開發(fā)工具和開發(fā)流程；
3，精通/熟悉verilog HDL和VHDL;4，有圖像采集及處理的開發(fā)經(jīng)驗(yàn)；5，有FPGA算法開發(fā)經(jīng)驗(yàn)；
6，有圖像視覺相關(guān)產(chǎn)品的開發(fā)調(diào)試經(jīng)驗(yàn)優(yōu)先。
(1)產(chǎn)品FPGA系統(tǒng)的需求分析，設(shè)計(jì)實(shí)現(xiàn)，功能驗(yàn)證，維護(hù)；
(2)完成產(chǎn)品中FPGA部分的邏輯接口設(shè)計(jì)開發(fā)；(3)完成產(chǎn)品中FPGA部分的算法設(shè)計(jì)開發(fā)；
(4)協(xié)助電子工程師完成相關(guān)硬件接口的功能測(cè)試驗(yàn)證，解決硬件問題；
(5)與軟件工程師一起完成相關(guān)驅(qū)動(dòng)接口功能性能的調(diào)試；
(6)高速信號(hào)的采集和調(diào)試；
(7)圖像算法類硬件加速的仿真和實(shí)現(xiàn)；(8)FPGA相關(guān)接口文檔協(xié)議的編寫。
任職要求：
1，本科或以上學(xué)歷，電子，計(jì)算機(jī)，自動(dòng)化，物聯(lián)網(wǎng)等相關(guān)專業(yè)；
2，精通/熟悉Xilinx或Altera FPGA開發(fā)工具和開發(fā)流程；
3，精通/熟悉verilog HDL和VHDL;4，有圖像采集及處理的開發(fā)經(jīng)驗(yàn)；5，有FPGA算法開發(fā)經(jīng)驗(yàn)；
6，有圖像視覺相關(guān)產(chǎn)品的開發(fā)調(diào)試經(jīng)驗(yàn)優(yōu)先。
工作地點(diǎn)
蘇州市-昆山市-章基路135號(hào)4號(hào)樓
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中電金信軟件有限公司
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周女士/人事經(jīng)理
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蘇州德沃蘇州德沃智能系統(tǒng)有限公司是由多名留美博士創(chuàng)建，位于昆山市留學(xué)生創(chuàng)業(yè)園，是昆山市重點(diǎn)扶持的領(lǐng)軍企業(yè)。德沃自成立以來，始終致力于自動(dòng)識(shí)別產(chǎn)品的研發(fā)與制造，是二維碼自動(dòng)識(shí)別和機(jī)器視覺領(lǐng)域的創(chuàng)新領(lǐng)導(dǎo)者之一。德沃將可以有效估計(jì)排序噪音數(shù)據(jù)的方法擴(kuò)展，并應(yīng)用于模糊識(shí)別、機(jī)器視覺技術(shù)方面。成功開發(fā)了多視頻視點(diǎn)摘要技術(shù)，其可以極大地減少分割視頻、關(guān)鍵幀圖像集內(nèi)容時(shí)所需的人工交互，從而方便對(duì)視頻和圖像集前景的精確分割。該方法被德國研究機(jī)構(gòu)作為標(biāo)準(zhǔn)的測(cè)試數(shù)據(jù)，被國內(nèi)最知名監(jiān)控設(shè)備生產(chǎn)廠商引用，并實(shí)現(xiàn)技術(shù)轉(zhuǎn)化。因此，德沃在基于采樣的圖像集分割方法、視頻摘要技術(shù)的應(yīng)用轉(zhuǎn)化、機(jī)器視覺技術(shù)方面，處于業(yè)內(nèi)領(lǐng)先水平。
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