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更新于 12月23日

FPGA設(shè)計(jì)工程師

2.5-4萬(wàn)·13薪
  • 上海閔行區(qū)
  • 3-5年
  • 碩士
  • 全職
  • 招1人

職位描述

Verilog HDLVHDL通信/網(wǎng)絡(luò)設(shè)備船舶/航空/航天/火車制造
崗位職責(zé):
1.對(duì)Xilinx FPGA 產(chǎn)品有深入了解,能評(píng)估芯片的性能參數(shù),包括邏輯單元數(shù)量、片內(nèi)存儲(chǔ)器容量、時(shí)鐘頻率、功耗等,以確保能夠滿足系統(tǒng)要求;
2.熟悉AD/DA器件的應(yīng)用,或熟悉數(shù)據(jù)處理交換技術(shù),熟悉各種通信協(xié)議如以太網(wǎng)協(xié)議、SPI 協(xié)議、I2C 協(xié)議,或擅長(zhǎng)通信信號(hào)處理算法實(shí)現(xiàn),或熟悉NVME,PCIE接口,或熟悉電機(jī)驅(qū)動(dòng)、伺服控制,或者擅長(zhǎng)各種信道編譯碼,滿足一條即可
3.能建立測(cè)試平臺(tái);
4.能與其他硬件工程師、軟件工程師協(xié)作,將 FPGA 模塊集成到系統(tǒng)中。
任職要求:
1.熟悉FPGA開發(fā)
2.熟悉通信原理,或計(jì)算機(jī)接口驅(qū)動(dòng),或伺服控制或信道編譯碼
3.電路設(shè)計(jì)相關(guān)專業(yè)
4.985,211學(xué)校碩士及以上
5.性格開朗,邏輯性強(qiáng),有責(zé)任心,能團(tuán)隊(duì)合作,善于學(xué)習(xí)

工作地點(diǎn)

上海市-閔行區(qū)-虹梅南路379弄28號(hào)802

職位發(fā)布者

施女士/綜合主管

三日內(nèi)活躍
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公司Logo北京融為科技有限公司
北京融為科技有限公司坐落于國(guó)家級(jí)經(jīng)濟(jì)技術(shù)開發(fā)區(qū)——北京亦莊經(jīng)濟(jì)技術(shù)開發(fā)區(qū),主要從事高速數(shù)傳接收設(shè)備、衛(wèi)星測(cè)控設(shè)備、彈箭地面遙測(cè)設(shè)備、便攜式衛(wèi)星地面終端設(shè)備、無(wú)人機(jī)數(shù)據(jù)鏈設(shè)備,以及高可靠硬件平臺(tái)和板卡的研發(fā)和生產(chǎn)。公司核心人員均來(lái)自于清華大學(xué)及華為,平均從業(yè)時(shí)間超過(guò)十年,參與過(guò)多個(gè)國(guó)家預(yù)研項(xiàng)目研發(fā)及重點(diǎn)型號(hào)的研制、交付、任務(wù)執(zhí)行工作,具有豐富的設(shè)備研制經(jīng)驗(yàn),所開發(fā)的產(chǎn)品具有完整的自主知識(shí)產(chǎn)權(quán),核心算法,程序,硬件平臺(tái),結(jié)構(gòu)等均為自研,目前已完成接近三十多項(xiàng)軟件著作權(quán)申報(bào)。北京融為科技有限公司生產(chǎn)的超高速數(shù)字調(diào)制解調(diào)器已在國(guó)內(nèi)多家單位廣泛使用(包括中科院空天信息創(chuàng)新研究院等)。
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