職位描述
VerilogVHDL
一、崗位職責(zé)：
1、負(fù)責(zé)FPGA軟件代碼編寫、模塊設(shè)計及仿真；
2、負(fù)責(zé)FPGA調(diào)試，資源優(yōu)化與時序優(yōu)化；
3、負(fù)責(zé)編寫開發(fā)過程中的各種技術(shù)文檔；
4、負(fù)責(zé)領(lǐng)導(dǎo)交辦的其他工作事宜
二、任職要求：
1、985、211院校畢業(yè)，2年以上FPGA開發(fā)經(jīng)驗；
2、熟悉FPGA架構(gòu)，了解常見的FPGA接口如DDR3、SerDes等；
3、精通Verilog語言，熟悉FPGA開發(fā)流程與開發(fā)工具；
4、具備良好的團隊意識和溝通能力，責(zé)任心及敬業(yè)精神。
1、負(fù)責(zé)FPGA軟件代碼編寫、模塊設(shè)計及仿真；
2、負(fù)責(zé)FPGA調(diào)試，資源優(yōu)化與時序優(yōu)化；
3、負(fù)責(zé)編寫開發(fā)過程中的各種技術(shù)文檔；
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二、任職要求：
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2、熟悉FPGA架構(gòu)，了解常見的FPGA接口如DDR3、SerDes等；
3、精通Verilog語言，熟悉FPGA開發(fā)流程與開發(fā)工具；
4、具備良好的團隊意識和溝通能力，責(zé)任心及敬業(yè)精神。
工作地點
北京海淀區(qū)硅谷亮城硅谷亮城5號樓506室
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