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崗位職責：
1. 架構與模塊定義：
參與芯片系統(tǒng)架構討論，負責數(shù)字子系統(tǒng)的微架構定義和規(guī)格制定。
深度理解超聲波信號處理算法（如波束成形、信號濾波、目標檢測等），并將其轉化為高效、可實現(xiàn)的硬件結構。
完成關鍵數(shù)字模塊（如DSP單元、接口控制器、狀態(tài)機、時鐘/復位管理）的設計文檔撰寫。
2. RTL設計與實現(xiàn)：
使用Verilog/SystemVerilog進行高質量、可綜合的RTL代碼編寫。
負責設計的面積、功耗和時序（PPA）的初步分析和優(yōu)化。
集成IP（如CPU、DSP、各類接口IP），并完成子系統(tǒng)級和芯片級的集成。
3. 前端綜合與時序分析：
主導模塊級和芯片頂層的邏輯綜合、形式驗證（Formality）和靜態(tài)時序分析（STA）。
與后端設計團隊緊密協(xié)作，提供時序約束和指導，確保時序收斂。
完成DFT（可測性設計）相關的插入和協(xié)同工作。
4. 驗證協(xié)同與調試：
與驗證工程師協(xié)同制定驗證計劃和測試用例，協(xié)助搭建測試平臺。
深入?yún)⑴c仿真調試，快速定位并解決RTL設計中的功能缺陷和性能瓶頸。
支持 FPGA 原型的構建和調試，協(xié)助進行系統(tǒng)級驗證。
5. 車規(guī)級設計與質量保證：
在設計過程中，嚴格遵循汽車電子功能安全標準（ISO 26262），并支持相關流程文檔的編寫。
應用和實現(xiàn)設計冗余、故障檢測、安全機制等可靠性設計技術。
支持芯片的可靠性測試（如HTOL， ESD， Latch-up）和故障分析。

任職要求：
1. 學歷與經驗：
微電子、電子工程、計算機等相關專業(yè)碩士及以上學歷。
5年以上數(shù)字IC前端設計經驗，有成功流片經驗，有車載芯片或高性能傳感器處理芯片（如雷達、激光雷達、圖像傳感器）設計經驗者優(yōu)先。
2. 知識與技能：
核心技能：
精通 Verilog/SystemVerilog 語言，具有豐富的 RTL 編碼和調試經驗。
精通數(shù)字電路設計基礎，深入理解CMOS電路和深亞微米工藝下的時序問題。
熟練掌握前端工具鏈：邏輯綜合工具（DC）、形式驗證（Formality）、靜態(tài)時序分析（PrimeTime）。
專業(yè)領域：
具有低功耗設計經驗（如UPF流程），了解功耗優(yōu)化技術。
熟悉AMBA（APB， AHB， AXI）等片上總線協(xié)議。
了解DFT、ATPG等相關知識者優(yōu)先。
行業(yè)標準：
了解ISO 26262功能安全標準，并有實際應用經驗者優(yōu)先。
熟悉AEC-Q100車規(guī)芯片認證流程者優(yōu)先。
3. 個人素質：
具備出色的分析和解決問題的能力，對技術難題有鉆探精神。
具備良好的團隊合作精神和溝通能力，能夠與架構、驗證、后端、軟件等多團隊高效協(xié)作。
具備強烈的責任心和嚴謹?shù)墓ぷ鲬B(tài)度，注重代碼和文檔的質量。