職位描述
Cadence數字設計集成電路設計數字前端設計數字前端驗證IP設計SoC設計MCU芯片電子/半導體/集成電路
崗位職責：
1、參與RTL的分析、設計、代碼編寫；
2、負責SOC中數字電路部分的設計，仿真和驗證；
3、參與FPGA驗證、芯片測試工作，以及文檔編寫；
4、協(xié)同系統(tǒng)電路設計工程師，確定電路設計規(guī)格。
任職要求：
1、微電子、電子信息科學與技術類相關專業(yè)。
2、碩士或本科1年及以上數字電路設計相關工作經驗。
3、有較好的數字電路基礎，熟悉正向設計流程，熟練使用vcs、dc等eda工具和verilog語言。
4、熟悉高速ADC芯片設計者優(yōu)先；
5、具備良好的溝通能力和團隊精神，認真的工作態(tài)度。
6、在我司實習的員工優(yōu)先。
職位福利：五險一金、績效獎金、帶薪年假、周末雙休、大牛帶隊、包住、年終分紅
工作地點
無錫市新吳區(qū)菱湖大道 111 號無錫軟件園天鵝座C座20樓
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潘女士/人事專員
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江蘇珞珈聚芯集成電路設計有限公司江蘇集萃智能集成電路設計技術研究所有限公司是江蘇省產業(yè)技術研究院下屬的由無錫高新區(qū)與集成電路領域***專家團隊共建的研究所。研究所將圍繞著集成電路設計核心技術的研發(fā)，集成電路設計優(yōu)秀團隊的引入和孵化，以及依靠資本力量扶持優(yōu)秀集成電路領域創(chuàng)新企業(yè)等三個方面，開展高效的市場化運作;同時研究所還建設了集成電路產業(yè)服務平臺，提供設計工具，測試，流片等一整套產業(yè)化服務。研究所期盼在集成電路領域擁有豐富成功經驗的優(yōu)秀人才的加入，共同為我國集成電路產業(yè)振興，增強我國在集成電路領域的國際競爭力做出應有的貢獻。
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